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用 Xilinx CPLD 与 NAND Flash 存储器器件接口

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将 DDR SDRAM 与 CoolRunner-II CPLD 接口

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利用 CoolRunner-II CPLD 和 SPI 闪存配置 Xilinx FPGA

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无需板仿真即可估计实际的输出时序

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133 MHz PCI-X 到128 MB DDR 小型 DIMM 存储器桥

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Virtex-5 系列高级封装

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使用 Virtex-5 FPGA 器件实现 DDR SDRAM 控制器（中文版）(

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单纠错和双检错（中文版）

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利用 Virtex-4 器件实现 QDR II SRAM 接口（中文版）(

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使用 Virtex-4 FPGA 器件实现 DDR SDRAM 控制器（中文版）

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利用 Xilinx FPGA 和存储器接口生成器简化存储器接口（中文版）

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将 64 位 DDR 存储器总线与 32 位微处理器总线接口

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使用 ISERDES 和 OSERDES 实现高性能 DDR2 SDRAM 接口数据采集

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利用直接时钟控制技术实现 DDR2 SDRAM 物理层

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用于实现 RAID6 奇偶性的硬件加速器

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存储器接口应用指南概述

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面向 Virtex-4 FPGA 的可综合 CIO DDR RLDRAM II 控制器

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