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VXI总线从模块时序控制器的VHDL语言设计

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摘　要:介绍了VXI总线从模块时序控制器的动作过程及其特点，并基于VHDL硬件描述语言，用异步MEALY状态机的方法进行VXI总线寄存器基接口的时序控制器的设计。

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