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H.264硬件视频解码，采用Verilog代码设计

资料介绍
H.264硬件视频解码，采用verilog代码设计，支持1.5M时钟下30bps的QCIF分辨率的实时视频解码
标签：FPGA资源，Altera
H.264硬件视频解码，采用Verilog代码设计
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