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AES算法的快速硬件设计与实现

资料介绍
基于FPGA并采用流水线技术和优化设计,提出了一种更高效的AES算法IP核的硬件设计方法.在使用较低时钟频率的情况下,可以获得更大的数据吞吐量和更快的传输速度.

标签：AES，FPGA，流水线，吞吐量，，，
AES算法的快速硬件设计与实现
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