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MC16 hard manual

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FPGA时序分析之Gated Clock

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跨时钟域设计经典

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例子

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Altera White Paper Input Signal Edge Rate Guidance

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cyc_c51006 Using PLLs in Cyclone Devices

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cyc_c5v1_02 Cyclone Device Handbook, Volume 1 Section II.Clock Management

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dclk calculation public version

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华为_大规模逻辑设计指导书

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introductiontoskew

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H8/520

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标准\rsds_specification_1.0

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高速数字系统设计

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老外做的LED旋转钟（电路图、源代码）

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Using Processor Expert to Develop a Software Real-Time Clock

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Clock Networks and PLLs in Cyclone III Devices

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Compromises of Using a 10-Gbps Transceiver at Other Data Rates

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