积分:0分 关键词:状态机,Verilog,Synplify Pro,FSM
积分:0分 关键词:CADENCE,Mentor,Xilinx,Altera,CPU设计,Verilog HDL,RISC CPU,设计实例,LWB,ModelSim,Xilinx3098,Altera Flex10K10
积分:0分 关键词:Synplify,UNIX,Script,HDL Analyst,Tcl,FPGA,Verilog,时间约束,速度优化
积分:0分 关键词:Verilog HDL,Verilog,HDL,表达式,门电平模型化,用户定义原语,数据流模型化,行为建模,结构建模