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华为同步电路设计规范

资料介绍
华为同步电路设计规范深圳市华为技术有限公司
研究管理部文档中心

文档编号

产品版本

密级

V1.0 产品名称:同步电路设计技术及规则

秘密 共27页

同步电路设计技术
及规则
(仅供内部使用)

FPGA
文 档 作 者: 研 究 部: 文档管理员: 周志坚

GROUP
日期: 日期: 日期: 1999/11/18

深圳市华为技术有限公司
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同步电路设计技术及规则

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修订记录[P1]
日期 修订版本 1999/11/18 1.00 描述 初稿完成 作者 周志坚

2005-10-21

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同步电路设计技术及规则

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1 设计可靠性 2 时序分析基础 3同步电路设计 3.1同步电路的优越性 3.2 同步电路的设计规则 3.3 异步设计中常见问题及其解决方法 3.4 不建议使用电路 4SET和RESET信号处理 5 时延电路处理 6 全局信号的处理方法 7 时序设计的可靠性保障措施 8ALTERA参考设计准则


4 4 5 5 6 6 17 18 19 20 24 25

2005-10-21

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2005-10-21

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同步电路设计技术及规则
1 设计可靠性 为了增加可编程逻辑器件电路工作的稳定性,一定要加强可编程逻辑器件设计的规范要求,要尽量 采用同步电路设计。对于设计中的异步电路,要给出不能转换为同步设计的原因,并对该部分异步电路 的工作可靠性(如时钟等信号上是否有毛刺,建立-保持时间是否满足要求等)作出分析判断,提供分析 报告。 2 时序分析基础 电路设计的难点在时序设计,而时序设
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