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Turbo简化译码算法的FPGA设计与实现

资料介绍
在深入分析Turbo译码算法的基础上,采用MAX-LOG-MAP算法进行了Turbo码译码器的FPGA设计与实现,并给出相应实现参数和结构.对FPGA的实现与MATLAB浮点算法做了仿真比较.


Turbo简化译码算法的FPGA设计与实现
赵旦峰,雷李云,杨建华
(哈尔滨工程大学信息与通信工程学院,黑龙江哈尔滨150001)

摘 要:在深入分析Turbo译码算法的基础上,采用MAX―LOG―MAP算法进行了Turbo码译码器
的FPGA设计与实现,并给出相应实现参数和结构。对FPGA的实现与MATLAB浮点算法做了仿真
比较。
关键词:Turl)o码MAX―LOG―MAP算法FPGA


Tu‰码自1993年提出以来…,由于其接近香农极 织方案【2】,在短帧情况下,MAX―LOG―MAP算法同样具
限的优异译码性能,一直成为编码界研究的热点。近年 有较好的译码性能。
来,用户对通信质量的要求越来越高,学者们已将研究 如图1所示,帧长为128,迭代6次,船R=10。5的数
重点从理论分析转移到Turbo码的实用化上来。Turbo码 量级时,MAX―LOG―MAP算法的译码性能比MAP算法
现已成为深空通信的标准,即第三代移动通信(3G)信 差大约0.6dB,比LOG―MAP算法差0.2dB左右。所以,
道编码方案【2】。 本文采用3GPP的交织和(13,15)编码方案,MAX―LOG―
Turbo码虽然具有优异的译码性能,但是由于其译 MAP译码算法进行短帧……
Turbo简化译码算法的FPGA设计与实现
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