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高速电子线路的信号完整性设计（三） 高速电子线路的信号完整性设计（三）
北京理工大学电子工程系 于波
5、串扰分析 当今飞速发展的电子设计领域，高速化和小型化已经成为一种趋势。如何在缩小电子系统体积的 同时，保持并提高系统的速度与性能成为摆在设计者面前的一个重要课题。信号频率变高，边沿变 陡，印刷电路板的尺寸变小，布线密度加大等都使得串扰越来越成为一个值得注意的问题。而随着电 子工程师不断把设计推向技术与工艺的极限，串扰分析变得越来越重要。本节讨论的串扰问题是高 速、高密度电路设计中需要重点考虑的问题，下面的仿真结果均是使用 Mentor Graphics 公司的 Interconnect Synthesis（IS）软件完成的。 5.1、串扰的基本概念 串扰是指当信号在传输线上传播时，因电磁耦合对相邻的传输线产生的不期望的电压噪声干扰。 过大的串扰可能引起电路的误触发，导致系统无法正常工作。 串扰是由电磁耦合形成的，耦合分为容性耦合和感性耦合两种。容性耦合是由于干扰源 （Aggressor）上的电压变化在被干扰对象（Victim）上引起感应电流从而导致的电磁干扰，而感性耦 合则是由于干扰源上的电流变化产生的磁场在被干扰对象上引起感应电压从而导致的电磁干扰。因 此，信号在通过一导体时会在相邻的导体上引起两类不同的噪声信号：容性耦合信号与感性耦合信 号。 5.2、几种典型情况的串扰分析 我们以图 13 为例，先来介绍一下串扰的有关术语。图中如果位于 A 点的驱动源称为干扰源 （Aggressor），则位于 D 点的接收器称为被干扰对象（Victim），A、B 之间的线网称为干扰源网 络，C、D 之间的线网称为被干扰对象网络；反之，如果位于 C 点的驱动源称为干扰源 （Aggressor），则位于 B 点的接收器称为被
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